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CoPoS de TSMC : révolution discrète de l'emballage

TSMC mise sur CoPoS, une méthode d'emballage intégrant une plaque de verre dans le substrat final pour réduire les interconnexions, augmenter la densité E/S et améliorer performances et dissipation pour l'IA et le HPC.

CoPoS de TSMC : révolution discrète de l'emballage
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Imaginez une fine plaque de verre qui reconfigure discrètement l'intérieur des puces les plus puissantes du monde. Cette image illustre la promesse de CoPoS, l'approche d'emballage que, selon les observateurs du secteur, TSMC développe.

La révolution discrète sous le verre

Des sources proches du dossier indiquent que CoPoS signifie Puce-sur-Panneau-sur-Structure. La méthode utilise le verre comme support temporaire pendant l'assemblage, puis ce même verre est intégré dans le substrat final sous la forme d'une pile à trois couches. Cela semble simple. Les implications, elles, ne le sont pas.

La production de masse devrait commencer d'ici la fin 2028. Le premier client de haut profil annoncé serait Nvidia, qui prévoit d'utiliser CoPoS pour son chipset IA Feynman. Cela a du sens : l'emballage de nouvelle génération vise clairement les charges de calcul à très large bande passante et haute performance où chaque millimètre d'interconnexion et chaque watt d'énergie comptent.

Pourquoi cela importe-t-il ? Parce que l'emballage dicte la manière dont les puces communiquent avec la mémoire et les accélérateurs. CoPoS vise à raccourcir ces liaisons, augmenter la densité d'E/S et offrir des voies thermiques plus propres. En termes simples : un coût par fonction plus faible et des performances soutenues supérieures pour les conceptions IA et HPC. Cette combinaison est rare dans la fabrication de semiconducteurs.

Il existe des risques et des réserves. L'intégration d'un support temporaire dans le substrat final est un ballet complexe de matériaux et de procédés. Le rendement, la fiabilité thermique et la préparation à long terme de la chaîne d'approvisionnement détermineront si CoPoS est évolutif ou véritablement révolutionnaire.

Si CoPoS fonctionne à grande échelle, TSMC pourrait consolider un avantage décisif et pousser ses rivaux à répondre par leurs propres avancées en matière d'emballage.

Alors, quoi ensuite ? Attendez-vous à un examen attentif des concepteurs de puces et des intégrateurs systèmes. Attendez-vous à ce que les concurrents accélèrent la R&D et poursuivent des voies alternatives pour obtenir des gains similaires. Et attendez-vous à ce que CoPoS devienne une référence pour mesurer les performances des emballages de nouvelle génération.

Toutes les nouvelles techniques ne tiennent pas leurs promesses. Mais lorsqu'un procédé promet à la fois une réduction des coûts et des gains de performances mesurables pour le matériel d'IA, toute la chaîne d'approvisionnement prête attention.

Sourcegsmarena.com
Nicolas Moreau

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